招聘--恒原微电子（上海）有限公司招聘

标 题: [招聘]--恒原微电子（上海）有限公司招聘
发信站: 水木社区 (Sun Aug 24 08:27:56 2008), 站内

恒原微电子招聘（上海）有限公司诚招以下模拟、数字、前、后端设计、验证等多个职位：

如果有符合条件并感兴趣的，请mail 联系我：chao.liu@


职位名称：通信系统工程师
1． 职责：
(1) 用C/C++开发UWB(OFDM)接收端的核心算法；
(2) 完成对性能、复杂度和存储空间需求的仿真和优化；
(3) 完成定点的C优化；
(4) 与‘物理层ASIC工作组’合作提出物理层ASIC架构。
2． 资格：
(1) 具有开发OFDM系统算法的丰富经验；
(2) 精通C/C++/Matlab编程；
(3) 透彻理解通信系统；
(4) 具有物理层FPGA/ASIC实现的经验。
3． 优先考虑：
有以下经验者：无线通信，定点优化，FPGA实现，物理层ASIC模块架构；博士学位。


职位名称：固件开发工程师
1． 职责
(1) 设计及编写产品和测试固件；
(2) 参与定义无线通讯产品的功能及软件构架；
(3) 了解并实现芯片的软件界面；
(4) 建立收集和分析芯片性能数据的测试环境；
(5) 协助主管制定详细工作计划；
(6) 致力于解决现存技术问题并积极提供创新思路。
2． 资格
(1) 计算机学士学位或同等学历；
(2) 2-5年固件编写经验；
(3) 良好设计和编程能力；
(4) 有RTOS应用知识；
(5) 有BSP应用知识；
(6) 能够与不同部门合作并同时处理多个项目的需求；
(7) 有调试硬件的经验和能力；
(8) 能够适应有压力的工作环境。
3． 优先考虑:
具有无线通讯背景者；硕士或以上学历。


职位名称：WINDOWS / LINUX 驱动开发工程师
1． 职责
(1) 设计及编写产品和测试驱动软件.
(2) 参与定义无线通讯产品的功能及软件构架.
(3) 了解并实现系统和应用的软件界面.
(4) 参与建立收集和分析芯片性能数据的测试环境.
(5) 协助主管制定详细工作计划.
(6) 致力于解决现存技术问题并积极提供创新思路.
2． 资格
(1) 计算机学士学位或同等学历.
(2) 2-5年WINDOWS或LINUX驱动编写经验.
(3) 良好设计和编程能力.
(4) 有PCI驱动开发经验.
(5) 能够与不同部门合作并同时处理多个项目的需求.
(6) 有调试硬件的经验和能力.
(7) 能够适应有压力的工作环境.
3． 优先考虑:
硕士以上学历和有USB驱动开发经验的候选人

职位名称：模拟/混合信号电路设计工程师
1． 职责
(1) 参加模拟和混合信号集成电路开发的各项工作；
(2) 产品功能定义和框架结构确定；
(3) 对竞争对手的现有产品和潜在新产品作功能性能和优势劣势评估；
(4) 研究用于新一代产品的技术；
(5) 基于已有技术开发新的技术和产品；
(6) 器件级和系统级的仿真和设计确认；
(7) 支持‘片上系统’（SoC）的功能块集成、版图设计和验证；
(8) 原型样品芯片的评估；
(9) 支持测试系统的开发；
(10) 产品发布；
2． 资格
(1) 在Bipolar and CMOS 工艺方面具有坚实知识基础；
(2) 具有对模拟集成电路进行测试和构建测试环境的能力；
(3) 在基本的模拟/混合信号电路方面具备设计CMOS器件模型、各种放大器、比较器、参考电压、数据转换器频率补偿；
(4) 熟悉Cadence 设计工具和UNIX操作系统；
(5) 出色的书面和口头沟通能力。
3． 优先考虑:
模拟/混合信号电路专业的硕士或博士。


职位名称：周边功能模块ASIC设计工程师
1． 职责
(1) 评估不同供应商提供的周边功能模块的性能和价格；
(2) 验证这些功能模块；
(3) 在UWB片上系统(SoC)上集成功能模块；
(4) 通过顶层测试平台仿真验证功能模块。
2． 资格
(1) 具有外围功能模块（PCI，USB和SDIO）集成、验证和排错的直接工作经验；
(2) 具有ASIC设计流程的丰富经验。
3． 优先考虑:
具有FPGA经验者；硕士或以上学位。


职位名称：物理层ASIC设计工程师
1． 职责：
(1) 与‘物理层系统工作组’合作提出物理层ASIC框图架构；
(2) 物理层算法的ASIC实现；
(3) 与‘MAC工作组’和‘固件组’合作完成‘物理层-MAC’接口；
(4) 物理层的FPGA验证和排错。
2． 资格：
(1) OFDM物理层实现的直接工作经验；
(2) OFDM物理层优化和排错的直接工作经验；
(3) 在ASIC设计流程，包括时序等方面有丰富经验。
3． 优先考虑:
有FPGA实现，无线通信IC设计经验者；硕士或以上学历。


职位名称：RF集成电路设计工程师
1． 职责
(1) 参加RF集成电路开发的各项工作；
(2) 产品功能定义和框架结构确定；
(3) 器件级和系统级的仿真和设计确认；
(4) 支持‘片上系统’（SoC）的功能块集成、版图设计和验证。
2． 资格
(1) 能够在晶体管级设计一种或多种下列单元LNA, Mixer, RFVGA, VCO, 综合器；
(2) 充分了解物理版图需求，能够完成关键的版图设计；
(3) 对IC设计CAD工具，如Spectre, ADS, Matlab等，具有扎实知识；
(4) 了解RF系统和通信系统；
(5) 具备实验室测试能力，能够对照设计规范评估原型样品。
3． 优先考虑:
RFIC专业的硕士或博士。


职位名称：资深MAC ASIC工程师
Position title: Senior MAC ASIC Engineer

1． Responsibilities:
(1) Develop MAC functional blocks for UWB SoC, including MAC datapath
(2) Perform verilog coding
(3) Support synthesis and timing closure
(4) Support FPGA based verification

2． Qualification:
(1) Solid experience in SoC development;
(2) Proficient in verilog coding;
(3) Thorough understanding of MAC;
(4) Solid experience in ASIC front end flow
(5) ARQ experience
(6) ARM/MIPS integration experience

3． Priority:
MAC implementation in ASIC, including ARQ implementation
SoC development
ASIC front end design and verification
FPGA mapping and verification


职位名称：SoC ASIC 设计工程师
1． 职责
(1) 在UWB片上系统(SoC)上集成ARM处理器和AMBA总线；
(2) 设计DMA；
(3) 实现MAC功能，如排队管理；
(4) 与‘物理层ASIC工作组’和‘固件工作组’合作完成‘物理层-MAC’接口。
2． 资格
(1) 具有SoC设计的丰富经验；
(2) 具有ASIC设计流程的丰富；
(3) 具有ARM/AMBA集成的经验；
(4) 具有DMA设计经验；
(5) 在复杂FIFO管理方面有经验。
3． 优先考虑:
有以下经验者：ARM 集成，AMBA总线，DMA和MAC；硕士或以上学位。

职位名称：资深ASIC验证工程师
Position title: Senior ASIC Verification Engineer
1． Responsibilities:
1) Working within an ASIC design team to develop reusable block-level and ASIC testbenches using high-level verification

language (System Verilog).
2) Develop new ASIC verification environments to support ASIC development.
3) Review RTL architectural and implementation specifications.
4) Create stimulus drivers, monitors, dataflow models, and test plans to verify function and performance of advanced SOC

ASICs.
5) Define and implement code/functional coverage plans.
6) Develop testing and regression methodologies for new verification flow.
7) Incorporate reusability into all aspects of the verification environment.
8) Develop/maintain/enhance environment tools/scripts/makefiles.

2． Qualification:
1) Minimum of 3 years ASIC verification experience in a product development environment with proven ASIC design

verification skills
2) Experience in using event-driven simulators like VCS
3) Fluent in Verilog for design verification
4) Experience in writing testbench using System Verilog
5) Knowledge of peripheral IP intergration (PCI, USB2.0, PCI)
6) Knowledge of AMBA/AHB/DMA
7) Experience with one or more scripting languages: Perl, TCL, Shell
8) Superior debugging skills for large ASIC designs
9) Strong written and verbal communication skills

3． Required Degree: MS
Preferred Major: Electrical Engineering or related discipline


职位名称：资深数字后端设计工程师
Position title: Senior Digital Back-end Design Engineer

Responsibilities:
1) Responsible for developing and verifying complex digital designs with emphasis on backend tasks, including Floorplan,

power planning and routing, CTS, PnR, RC extraction, ECO, DRC, LVS.
2) Work with RTL designers to optimize timing/area/power of the physical design implementation and perform static timing

analysis.

Qualification:
1) 3-5 years experience in backend design flow with proven SOC tapeout experience.
2) Expertise in floorplan, place and routing, signal integrity, power analysis, CTS, DFT, ECO, DRC, LVS.
3) Experienced in Synopsys/Cadence) physical design tools and flows.
4) Experienced in Mentor’s Calibre flow for DRC/ERC/LVS/Antenna flow.
5) Strong timing analysis capabilities.
6) Experience with one or more scripting languages (Perl, TCL, Shell) to automate physical design flow.
7) Good analytical and debugging skills.
8) Strong written and verbal communication skills.


Required Degree: BS
Preferred Degree: MS
Preferred Major: Electrical Engineering or related discipline


职位名称：资深高速数字滤波器设计工程师
Position title: Senior High Speed Digital Filter Design Engineer

1． Responsibilities:
(1) Develop high speed digital filter with custom design flow
(2) Low power optimization using custom design

2． Qualification:
(1) Solid experience in full custom high speed digital design development;
(2) Proficient in digital filter design
(3) Thorough understanding of CMOS device

3． Priority:
High speed digital filter design

CMOS full custom design flow

Low power optimization with CMOS device

--

36 修改:·lnlc 于 Aug 24 08:28:56 2008 修改本文·[FROM: 218.82.242.*]
33 来源:·水木社区 ne***net[点击查看]·[FROM: 218.82.242.*]
0应届生求职网倾力打造：2009届应届生求职全程指南(第三版)-累计下载超过百万次，必看资料