锐迪科微电子（上海）有限公司招聘logic design engineer

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锐迪科微电子（上海）有限公司


logic design engineer
电子邮箱：	">ghyang@

发布日期：	2007-04-25	工作地点：	上海市

招聘人数：	3

薪水范围：	面议

学历：	本科	接受简历语言：	中文或英文

职位描述：
Participate in the logic design of high-speed mixed signal ASIC's for communication,
computing and consumer products. Candidate will be responsible for micro architecture
definition, design entry and verifition, synthesis and P&R (place and route) oversee.

公司简介

锐迪科微电子（上海）有限公司和锐迪科无线通信技术（上海）有限公司均由美国著名风险投资商WARBURG PINCUS出资成立，公司产品主要在两个领域：1）射频芯片的研发和生产； 2）3G基站中的高效、高线性功率放大器的研发和生产。

公司拥有国际先进水平的核心技术、规范的管理制度，对员工采用开放式的管理方式，并为员工提供优厚的福利待遇、广阔的事业发展空间和颇具竞争力的薪资。

如果您有意，请将您的中英文简历（请注明应聘的职位）通过Email或邮寄给我们。我们将尽快给您回复。所有的简历将存入公司人才库，今后我们将优先从人才库中选择。请勿来访。

工作地点：上海张江高科技园区(距离张江地铁站100米)或者北京海淀区知春路113号

公司网站：	ww***com[点击查看]
传真：	(021)50271099
联系人：	Mr. zhang
电话：	(021)50271108

@YingJieSheng.COM

千里之行，始于足下。