- 工作地点：北京
- 职位：Cadence北京研发中心招聘(AHDL group)
- 信息来源：北京化工BBS
说明：
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发信站: 胜古朝阳 BBS 站 (Fri Dec 28 23:43:26 2007), 站内
发信站: 水木社区 (Fri Dec 28 15:38:43 2007), 站内
Title:
Member of technique stuff for Verilog-A simulator development
Job Description:
- Develop, enhance and maintain Verilog-A simulator.
Requirements:
- Familiar with Spice, Verilog-A, Verilog-AMS language
- Skilled in C++ programming, familiar with development under Linux/Unix
environment.
- Analog circuit or digital simulator development experiences .
Well understanding on circuit simulation technology, including MNA, dc, tran
method.
- Good mathmatic background & knowledge.
- Be familiar with Analog Mixed-signal design is a plus.
- EE or CS Master degree.
请将中、英文简历发送至wangpeng@
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n年以后我们和Yao一起老去的时候,当我们的孩子问:"爸爸,火箭队场上那个又老又慢的
11号中锋你为什么那么崇拜他啊?"我们会骄傲地告诉他:"孩子,在你爸爸年轻的时候,那
个11号只要他愿意可以每晚砍下30分10板蹂躏全世界每一个中锋!"
1;35 来源:·胜古朝阳 BBS 站 ·[FROM: 北京化工大学]
@YingJieSheng.COM
欲望以提升热忱，毅力以磨平高山。
