- 工作地点：其它
- 职位：ASIC前端设计工程师
- 信息来源：中国科学技术大学
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1.电子类相关专业均可，本科以上学历。
2.积极主动，诚信正直，具有较强的抗压能力、良好的学习能力、逻辑思维能力和团队合作能力；
3.有数字逻辑设计/时序电路基础知识和基本技能，熟悉Verilog、数字电路的综合和静态时序分析、具备数据通信系统知识者优先。
发布时间
2017-10-31
联系电话：
0512-62727221
应聘邮箱：
li.guo@
工作地点：
江苏省苏州市市辖区
